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Implementazione Di Un'architettura Core RISC a 32 Bit Ad Alte Prestazioni

Implementazione Di Un'architettura Core RISC a 32 Bit Ad Alte Prestazioni

Paperback

Technology & Engineering

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ISBN10: 6206245756
ISBN13: 9786206245759
Publisher: Ed Notre Savior
Published: Jul 18 2023
Pages: 80
Weight: 0.28
Height: 0.19 Width: 6.00 Depth: 9.00
Language: Italian
Questo libro tratta della progettazione di un processore RISC utilizzando l'architettura pipelined. Il pipelining a 5 stadi viene utilizzato per migliorare la velocità delle operazioni. Le 5 fasi sono Fetch, Decode, Execute, Memory e Write Back. Il processo di progettazione comprende varie tecniche a basso consumo a livello architettonico, che dimostrano come questi metodi siano più efficienti delle tecniche di riduzione del consumo di back-end. I processori embedded a basso consumo sono utilizzati in un'ampia gamma di applicazioni, tra cui automobili, telefoni, fotocamere digitali, stampanti e altri dispositivi simili. Il motivo del loro ampio utilizzo è che sono di dimensioni ridotte, quindi non occupano molta area dello stampo e sono economici da fabbricare. Il basso consumo energetico aiuta a ridurre la dissipazione di calore, ad allungare la durata della batteria e ad aumentare l'affidabilità del dispositivo.

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