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Manuale completo di VHDL e Verilog: Dai fondamenti della logica digitale alla progettazione e verifica di sistemi digitali su FPGA
Paperback
Series: Programmazione, Book 63
Technology & EngineeringGeneral Mathematics
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ISBN13: 9798191139746
Publisher: Independently Published
Published: Aug 6 2026
Pages: 808
Weight: 3.03
Height: 1.60 Width: 7.00 Depth: 10.00
Language: Italian
Publisher: Independently Published
Published: Aug 6 2026
Pages: 808
Weight: 3.03
Height: 1.60 Width: 7.00 Depth: 10.00
Language: Italian
Due linguaggi, un solo modo di pensare l'hardware.
C'è un momento preciso in cui chi progetta sistemi digitali si blocca: apri un file VHDL o Verilog, scrivi tre righe che sembrano un programma, lanci il simulatore e ottieni un risultato senza senso. Il problema non è la sintassi: è che un linguaggio di descrizione dell'hardware assomiglia in modo ingannevole a un linguaggio di programmazione, ma obbedisce a leggi completamente diverse.
C'è un momento preciso in cui chi progetta sistemi digitali si blocca: apri un file VHDL o Verilog, scrivi tre righe che sembrano un programma, lanci il simulatore e ottieni un risultato senza senso. Il problema non è la sintassi: è che un linguaggio di descrizione dell'hardware assomiglia in modo ingannevole a un linguaggio di programmazione, ma obbedisce a leggi completamente diverse.
Questo manuale accompagna il lettore attraverso quel passaggio e lo porta molto oltre. Presuppone la conoscenza dell'elettronica digitale e della programmazione, e usa entrambe come leva: non spiega che cos'è un flip-flop, spiega come descriverlo, quanto costa e perché l'intuizione del programmatore porta fuori strada.
Perché due linguaggi insieme
Nel lavoro reale VHDL e Verilog convivono. Ma la ragione più profonda è didattica: imparare i due linguaggi insieme rivela che cosa è essenziale e che cosa è accidentale. La sintassi diventa trasparente e sotto compare la sostanza, che è sempre e soltanto circuitale.
Che cosa contiene
Oltre 200.000 parole, 47 capitoli in sei parti, 8 appendici.
Apertura con un problema di progetto reale, teoria con esempi tutti simulabili, box di avvertimento sulle trappole di sintesi, una sezione Con l'IA con tre prompt pronti all'uso e una valutazione onesta dei limiti dei modelli linguistici su questo dominio, tre esercizi svolti passo per passo e cinque proposti. Tutte le 235 soluzioni sono in appendice.
A chi si rivolge
Ogni esempio è verificato con GHDL, Icarus Verilog, Verilator, GTKWave, Yosys e nextpnr: nessuna licenza commerciale, nessun ambiente da migliaia di euro, tutto riproducibile su un portatile qualunque. Il Capitolo 3 guida l'installazione passo per passo su Linux, macOS e Windows.
Un volume di riferimento per chi progetta su FPGA, per chi studia elettronica digitale e per chi deve leggere, scrivere e tradurre codice nei due linguaggi che dominano il settore da quarant'anni.
Perché due linguaggi insieme
Nel lavoro reale VHDL e Verilog convivono. Ma la ragione più profonda è didattica: imparare i due linguaggi insieme rivela che cosa è essenziale e che cosa è accidentale. La sintassi diventa trasparente e sotto compare la sostanza, che è sempre e soltanto circuitale.
Che cosa contiene
Oltre 200.000 parole, 47 capitoli in sei parti, 8 appendici.
- Parte I - Dal circuito al codice. Il salto mentale da esecuzione a descrizione, il flusso completo dall'RTL al silicio, la toolchain libera, lo stesso circuito nei due linguaggi.
- Parte II - VHDL. Entity e architecture, il sistema dei tipi, segnali e variabili, descrizione concorrente e sequenziale, package, generic e generate, le novità del 2008 e del 2019.
- Parte III - Verilog e SystemVerilog. Module e porte, i quattro stati, le regole di larghezza, il blocco always, assegnazioni bloccanti e non bloccanti, task e function, l'evoluzione a SystemVerilog, una guida completa alla traduzione fra i due mondi.
- Parte IV - Progettazione RTL. Macchine a stati, datapath e control path, memorie, aritmetica e virgola fissa, pipeline, domini di clock, vincoli temporali, sintesi, ottimizzazione, differenze fra FPGA e ASIC.
- Parte V - Verifica. Testbench auto-verificanti, verifica avanzata in VHDL, classi e randomizzazione vincolata in SystemVerilog, assertion SVA e PSL, verifica formale, cocotb e UVM.
- Parte VI - Progetti completi. UART e SPI, controller VGA e filtro FIR, e come progetto finale una CPU RISC-V RV32I costruita per intero.
Apertura con un problema di progetto reale, teoria con esempi tutti simulabili, box di avvertimento sulle trappole di sintesi, una sezione Con l'IA con tre prompt pronti all'uso e una valutazione onesta dei limiti dei modelli linguistici su questo dominio, tre esercizi svolti passo per passo e cinque proposti. Tutte le 235 soluzioni sono in appendice.
A chi si rivolge
- A chi progetta su FPGA e deve integrare, leggere o tradurre codice nei due linguaggi.
- A chi ha studiato elettronica digitale e vuole passare dalla teoria all'implementazione.
- A chi conosce già uno dei due linguaggi e deve imparare l'altro senza ricominciare da capo.
Ogni esempio è verificato con GHDL, Icarus Verilog, Verilator, GTKWave, Yosys e nextpnr: nessuna licenza commerciale, nessun ambiente da migliaia di euro, tutto riproducibile su un portatile qualunque. Il Capitolo 3 guida l'installazione passo per passo su Linux, macOS e Windows.
Un volume di riferimento per chi progetta su FPGA, per chi studia elettronica digitale e per chi deve leggere, scrivere e tradurre codice nei due linguaggi che dominano il settore da quarant'anni.
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